图4．14正弦信号20倍内插多相实现仿真图 用FPGA设计多相结构插值时，主要由4个模块构成。它们分别为时钟及控 制模块、输入存储控制模块、系数模块和滤波器模块。具体实现框图如4．15所示： 图4．15多相插值结构实现框图 时钟模块由FPGA中自带的时钟模块构成，而控制模块可以起到辅助的作用， 即可以选择使用外部输入的时钟作为插值时钟。此外，控制模块还可以根据输入 信号强弱对滤波后的输出的不同位进行取舍控制。 输入存储模块由25个寄存器构成，其输入时钟与输入信号的采样时钟同步， 但读取时钟为插值时钟，这样在每个寄存器中存储的数据可以读取20次。保证了 后面的滤波器模块可以被复用20次。 系数模块由ROM及存储在其中的系数构成，在此设计中，有25个深度为32， 字长为16 bits的ROM构成。每个ROM中相同地址上的数共同构成每个单通道的 1 8 6 4 2 O O O O O 1 8 6 ‘ 2 O O O O O

第三章超高频l疆ID读写器射频电路原理分析 过低通滤波器滤除高频信号后变换成模拟信号b(t)(b(t)见附录A中图(b))，然后 和本振信号进行混频，混频后滤除带外杂波，形成AM调制信号s(t)(s(t)见附录 A中图(c))。DSB-ASK和SSB．ASK电路结构见图3．1和图3-2。 数字基带 模拟信号 已调信号 图3．1 DSB．ASK电路结构框图 数字基带 模拟信号 已调信号 图3．2 SSB．ASK电路结构框图 PR．ASK调制首先把数字基带信号an(an见附录A中图(e))反向转换，即 数字基带信号上升沿时输出脉冲信号电平转换；然后把反向转换后的脉冲信号通 过低通滤波器，变换为均值为零的模拟信号b(t)(b(t)见附录A中图(f))；最后把 模拟信号与本振信号进行混频形成DSB信号s(t)(s(t)见附录A中图(g))。PR-ASK 电路结构见图3．3。 图3．3 PR-ASK电路结构框图 通过以上三种调制方式分析，在性能指标方面，DSB．ASK调制的数据，信 号占用的最小带宽为传输速率的4倍；对于SSB．ASK调制的数据是3倍；对于 PR．ASK调制的数据则为2倍：调制方式实现和结构复杂度方面，DSB．ASK比 SSB．ASK和PR．ASK都更容易实现，且结构更简单。

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