为监测和控制航天器用电源控制器的工作状态,保障其正常运行,该系统接口采用协议芯片 BU-61580.基于FPGA时序逻辑控制,设计一种MIL-STD-1553B.总线通信系统,并对该遥测遥控系统的通信硬件电路及时序逻辑控制进行了详细设计,在简化系统外围硬件电路设计的同时提高了集成度;最后,通过测试板卡对总线通信系统进行了遥测遥控测试,测试结果证明了系统的正确性.
2022-11-10 14:23:47 424KB 自然科学 论文
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参照can芯片 saj1000控制器结构,写的can控制器
2022-11-07 15:41:42 861KB CAN fpga FPGA控制器 fpga实现CAN
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1、 AD5754是16bit数字信号转模拟信号 2、 FPGA与AD5754通过SPI接口通信,SPI时钟clk最大30MHz 3、 AD5754有四路模拟输出 4、 目前AD5754采用单极性工作方式 5、 按照目前的理解,同轴的速度和电流指令应该同时刷新,根据写时序可以用LDAC引脚控制模拟信号的刷新,需要实际验证一下。 6、 实际验证一下CLR信号的效果。 7、 FPGA往DAC写数据的时序接口
2022-09-30 19:51:38 590KB AD5754 FPGA Verilog
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基于北京精仪达盛科技有限公司的实验箱,用VHDL开发4x8矩阵键盘与液晶接口,并实现BCD码加法运算与十进制调整显示,是课程设计的优秀作品
2022-06-19 23:54:26 2.86MB FPGA 矩阵键盘 汉字液晶
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本文描述了LTC2207芯片的功能特性、时序控制方式和基本工作原理,在S3C2440和EP3C25处理器的控制下实现了LTC2207的采集应用,并给出了LTC2207的硬件和软件设计。
2022-06-14 07:10:22 85KB LTC2207 S3C2440 采集系统 文章
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利用FPGA控制VGA输出在CRT显示器上实现乒乓球游戏,工程在\project文件夹里面;源文件和管脚分配在\rtl文件夹里面;下载文件在\download文件夹里面,.mcs为PROM模式下载文件,.bit为JTAG调试下载文件。在xilinx xc3s400调试通过
2022-06-11 09:40:11 998KB FPGA VGA 乒乓球 verilog
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基于FPGA控制的高速数据采集系统设计与实现.pdf 好资源大家共享。
2022-05-13 14:51:05 19.74MB fpga 高速数据采集
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基于FPGA控制的高速数据采集系统设计与实现 高速高精度 A/D转换芯片、高性能FPGA、PC/总线接口、DB25并行接口组成的高速数据采 集系统设计方案及实现方法。其中FPGA作为本系统的控制核心和传输桥梁,发 挥了极其重要的作用。通过FPGA不仅完成了系统中全部数字电路部分的设计, 并且使系统具有了较高的可适应性、可扩展性和可调试性
2022-05-13 14:50:18 3.96MB FPGA 数据采集
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FPGA控制的含fifo的SDRAM程序 总体分为FIFO后的SDRAM控制器顶层文件和SDRAM初始化模块,以及相应的仿真程序
2022-02-10 09:57:55 334KB SDRAM FPGA
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Cyclone10LP FPGA控制SD卡音乐播放Verilog例程源码Quartus17.1工程文件+文档资料,FPGA为CYCLONE10LP系列中的10CL025YU256C8. 完整的Quartus工程文件,可以做为你的学习设计参考。 module top( input clk, input rst_n, input key, input wm8731_bclk, //audio bit clock input wm8731_daclrc, //DAC sample rate left right clock output wm8731_dacdat, //DAC audio data output input wm8731_adclrc, //ADC sample rate left right clock input wm8731_adcdat, //ADC audio data input inout wm8731_scl, //I2C clock inout wm8731_sda, //I2C data output sd_ncs, //SD card chip select (SPI mode) output sd_dclk, //SD card clock output sd_mosi, //SD card controller data output input sd_miso, //SD card controller data input output [3:0] led ); wire[9:0] lut_index; wire[31:0] lut_data; wire[3:0] state_code; //I2C master controller i2c_config i2c_config_m0( .rst (~rst_n ), .clk (clk ), .clk_div_cnt (16'd99 ), .i2c_addr_2byte (1'b0 ), .lut_index (lut_index ), .lut_dev_addr (lut_data[31:24] ), .lut_reg_addr (lut_data[23:8] ), .lut_reg_data (lut_data[7:0] ),