二次拟合MATLAB m文件代码二元二次Logistic回归 该存储库提供了一个示例MATLAB代码,以执行监督的机器学习算法:用于二进制分类的Logistic回归。 储存库的组织 主MATLAB文件名为“ BinaryLogisticRegressionQuadratic.m”,而其他MATLAB文件是主文件中使用的功能。 无论维数是多少,您都可以将算法与所需的任何数据集一起提供(但要考虑到训练集必须是二进制分类)。 但是,以两组输入数据为例来实现该算法。 根据数据集具有的变量数量,算法可能会绘制输入数据和决策边界。 此外,除了非正规学习参数之外,还包括形成成本函数的正规方法,以解决过度拟合的问题。 这些代码是不言自明的,并包含注释以增进您对所发生情况的理解。 此外,无论需要什么干预,代码中的注释都会提示您这样做。 输入数据 文件dataQuad.txt是一个两变量数据集,包含用于逻辑回归的数据,以便基于对它们进行的两次测试的结果来预测微芯片是否通过了质量保证。 我们在第一和第二列中有两个测试结果的数据,在第三列中有质量保证指标。 使用此数据集,我们想确定是否应该接受或拒绝micri
2021-12-02 09:33:10 10KB 系统开源
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充电宝芯片IP5306_I2C协议资料
2021-11-26 11:04:08 644KB IP5306 I2C 协议书
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win7系统下安装sp8。MicroWIN 4.0 SP4-SP8升级包程序直接安装.reg )
2021-11-21 10:08:59 442B SP8升级包
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2021-11-17 10:01:06 329KB reg转vbs regtovbs regtobat regtoexe
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替换法,完美解决WIN7 \WIN10下 仿宋_GB2312、楷体_GB2312不正常显示的问题,显示为操作系统自带 仿宋、楷体!
2021-11-15 09:58:46 342B WIN7 WIN10 OFFICE 仿宋_GB2312
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基于fpga的32位桶式移位寄存器实现,参考文档《三十位桶式移位寄存器的FPGA实现--杜慧敏》
2021-11-14 17:30:17 214KB FPGA SHIFT_REG
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Verilog语言中wire与reg的区别以及inout使用
2021-11-14 12:50:23 29KB Verilog wire reg inout
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Windows预体验计划连接不上,执行此脚本解决
2021-11-01 21:01:13 763KB 预体验计划
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一個System Task,能夠接受由Verilog的reg或wire傳給C的值。
2021-10-29 13:50:52 33KB Verilog reg wire C
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outlook 邮件超链接无法跳转修复, 双击运行
2021-10-22 09:00:19 103B outlook
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