基于FPGA的四相序载波发生器设计

FPGA verilog DDS

本代码以开发软件QuartusⅡ为工具。采用EDA设计中的自顶向下与层次式设计方法，使用精简的DDS算法完成了输入为14MHz，输出四路频率为70MHz的四相序正弦载波（相位分别为0°、90°、180°、270°）的设计。利用Verilog HDL语言进行了程序设计并用QuartusⅡ对设计进行了仿真，验证了其正确性。

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评论信息

hhit000 :

这方面的代码不多呀，难得
2013-05-18
xinxinyu2012 :

很需要这方面资料，下载了看看！
2012-12-20

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