CAN FD Controller IP Core

上传者: 36433853 | 上传时间: 2025-12-17 22:15:16 | 文件大小: 700KB | 文件类型: PDF
CAN
标题:“CAN FD Controller IP Core”表明了文章讨论的核心是CAN FD(Controller Area Network Flexible Data-rate)控制器IP(Intellectual Property,知识产权)核心。这个IP核是一个在集成电路设计中用于实现CAN协议的功能模块。在自动化和工业领域中,它被广泛应用于需要CAN网络连接的设备中。 描述中提到的CAN FD控制器IP核支持CAN 2.0A和CAN 2.0B协议,符合ISO 11898-1标准。描述中的“ISO CAN-FD – ISO 11898-1:2015 DIS compliant”指的是该控制器完全符合2015年发布的ISO 11898-1标准草案(DIS),这个标准是针对CAN FD的一种更新,提高了数据传输速率和帧的负载数据长度。另外,“Non-ISO CAN FD - Compliant to Bosch Spec.”意味着该IP核也符合Bosch公司制定的非ISO标准CAN-FD规范。Bosch是CAN技术的开发者,他们在标准之外也定义了一套自己的CAN-FD协议版本。 在标签中,“CAN FD”被重复强调,表明了文档的主题和重点。 内容部分包含了对Arasan CAN FD IP核心的详细描述,以下是对这些内容知识点的梳理: - Arasan CAN FD IP核心实现了CAN 2.0A和CAN 2.0B协议,同时与ISO 11898-1标准兼容。这表明该核心可以用于不同层级的CAN网络通信,从基本的CAN 2.0A/B到高级的CAN-FD协议。 - 该IP核支持独立的系统时钟(SYSCLK)和CAN总线时钟(CANCLK),这允许控制器在不同频率下与CPU或其他外部设备通信,从而提高整个系统的灵活性和性能。 - 可配置的缓冲区方案,意味着可以自定义发送和接收消息的缓冲大小。这样的设计提供了灵活的数据处理能力,可以针对不同的应用场景调整缓冲区大小来满足需求。 - 灵活的共享缓冲机制实现了最优的缓冲区大小分配,可以依据应用场景需要来定制传输和接收缓冲区的大小。 - 缓冲区可以实现为单一端口SRAM,方便在FPGA或ASIC设计中集成。 - 提供了参数化的接收过滤器数量选择,从1到16个过滤器不等,这为消息过滤提供了灵活性,可以更有效地处理网络中的消息。 - 提供了AHB-Lite从机接口用于连接CPU,并且支持可选的APB(Advanced Peripheral Bus)接口,这为与CPU和其他外设之间的通信提供了灵活的接口选项。 - 提供了可编程波特率预分频器(BRP),允许用户从CANCLK生成时间量子时钟,并且带有8位BRP寄存器,可以支持除2到除255的分频范围,进一步增加了数据传输速率和灵活性。 Arasan CAN FD IP核的优势在于其完全符合最新的ISO标准,具有较小的芯片占用面积(小尺寸)和高度的代码质量。它的功能在FPGA上得到了验证,并得到了Arasan设计工程师的直接支持。 Arasan CAN FD IP核心概述中还提到了该控制器可以用在汽车和工业应用中的CAN网络连接设备中。这表明了控制器的应用广泛,尤其是在需要高速、高可靠性的数据通信环境中。 文档还提到了Arasan CAN FD转换器IP核心,它符合ISO 11898-2和ISO 11898-5标准,为控制器提供了物理层的解决方案,进一步完善了Arasan提供的CAN-FD网络整体解决方案。

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