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基于FPGA设计多功能数字钟(VHDL程序)
基于FPGA设计多功能数字钟(VHDL程序)
上传者:
ttt19880110
|
上传时间: 2021-06-28 15:04:15
|
文件大小: 37KB
|
文件类型: DOC
VHDL
FPGA
多功能数字钟VHDL程序 本文所设计的数字钟具有通过reset键对时、 分、 秒调整功能.该设计分为六个部分: 六进制计数器 counter6,十进制计数器 counter10 ,二十四进制计数器 counter24, 时钟模块 bclock, LED扫描显示模块 ledctrl,以及顶层设计。设计使用VHDL 语言, 程序代码如下:
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评论信息
lovedou6 :
不错,帮我过了实验课
2014-04-15
tramp1109 :
资料很好,入门级
2014-02-08
u012611166 :
好东西呀 帮助设计
2013-11-09
taoxiner :
多谢大神,终于把作业给交上去了
2013-09-07
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