考核项目及评分标准 1．基于Verilog语言采用有限状态机设计彩灯控制器，控制LED灯实现预想的演示花型。利用计数器对规定花型演示次数进行计数，同时利用七段数码管线上计数的十进制数。 2．设计内容： （1）功能：设计彩灯控制器，要求控制16个LED灯演示花型一个周期为：从两边往中间逐个亮，全灭；从中间往两头逐个亮，全灭；循环以上行为过程。 （2）一个周期的花型演示完毕后计数器进行计数（0—9），同时用七段数码管线上计数结果。 （3）添加复位按钮，复位后花型演示以及计算功能清零。 （4）采用有限状态机设计，利用vivado自带的仿真软件编写TestBench文件对设计测试。 （5）按要求完成电子版实验报告，需体现设计思路并附上源码。

FPGA设计的彩灯控制器 VHDL语言写的 有实验书 自己写的程序编译环境Quartus II 9.0 4个模块一个顶层文件 FPGA开发全攻略_上和下 内含VHLD部分PPT围绕maxplus2的