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verilog写的数字频率计，97年电赛题目

用altera的CYClone系列的fpga，verilog写的代码，可以分离出LCD显示字符和变量（频率值）的程序，用的是AD9226,12位AD，可以精确测量，经调试可测频率高达100MHZ，误差小于0.01.

2019-12-21 20:11:49 662KB 已经过调试

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VHDL课程设计报告-数字频率计

VHDL课程的综合设计报告，是一个数字频率计的，含完整代码

2019-12-21 20:11:25 6.72MB VHDL 数字频率计 设计报告

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采用测频原理的数字频率计

1.采用测频法 2.设计一个4位十进制数字显示的数字频率计 3.其测量的范围为1~9999KHz

2019-12-21 20:11:03 69KB FPGA 数字频率计

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基于FPGA的多进制数字频率调制(MFSK)系统

多进制数字频率调制也称多元调频或多频制。 M频制有M个不同的载波频率与M种数字信息对应，即用多个频率不同的正弦波分别代表不同的数字信号，在某一码元时间内只发送其中一个频率。

2019-12-21 20:11:03 166KB FPGA MFSK

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采用TTL电路设计的数字频率计

本文描述了采用TTL电路来设计一个频率计

2019-12-21 20:09:43 302KB TTL 频率计

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基于FPGA数字频率计的实现

基于FPGA数字频率计的实现对学习很有帮助

2019-12-21 20:08:49 10KB 基于FPGA数字频率计的实现

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基于51单片机的数字频率计（源码+原理图）

采用AT89C52单片机智能控制，结合外围电子电路，设计的频率计性能稳定。在软件设计上采用了单片机的C语言设计，通过单片机内部定时/计数器同时动作，在测量频率时将测频率和测周期相结合,提高了频率计的测量准确性。

2019-12-21 20:08:47 163KB 单片机 频率计 1602

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基于FPGA的数字频率计（ISE工程）

根据全国大学生电子设计竞赛题目《简易数字频率计》的要求设计，测量范围0-1Mhz ，测量精度满足题目中要求，所用开发板为 xilinx spartan 3ES。具体设计过程可以参考博客。http://blog.csdn.net/li200503028

2019-12-21 20:07:30 1.31MB 频率计 FPGA verilog

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基于FPGA的数字频率计设计与仿真

基于FPGA的数字频率计设计与仿真，设计了一个简单的数字频率计，对于初学者有一定的帮助

2019-12-21 20:00:37 159KB FPGA、数字频率计

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一种基于DDS芯片AD9835的多种信号发生器

本文介绍用89C51单片微机控制直接数字频率合成器（ＤＤＳ）芯片AD9835设计的高精度多种信号发生器，着重讨论了AD9835基本工作原理、与89C51接口，单片微机控制系统的硬件结构及软件设计框图。

2019-12-21 19:52:55 130KB 单片机直接数字频率合成（DDS） AD9835芯片信号发生器

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