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反相器链
缓冲器
级数和尺寸优化,D触发器设计及输出延时优化
VLSI设计和优化问题,包括两个内容:反相器链
缓冲器
级数和尺寸优化,D触发器设计及输出延时优化。使用hspice网格形式设计优化,文档内代码可直接使用。
2019-12-21 19:57:59
1.41MB
反相器
D触发器
设计优化
hspice
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