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FPGA_veriog_Quartus_DDS

用quartus 13.1 写的代码，DDS信号发生器模块，里面有详细注释，原理解释。

2019-12-21 19:34:42 10.88MB verilog FPGA Quartus

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基于51单片机的DDS信号发生器（AD9833）程序

C语言，基于51单片机的DDS信号发生器（AD9833）程序

2019-12-21 19:34:13 83KB DDS AD9833

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《基于FPGA的任意信号发生器》毕业论文完整稿

《基于FPGA的任意信号发生器》毕业论文完整稿，详细描述了用FPGA实现DDS信号发生器的方法，适合做毕设的同学参考

2019-12-21 19:29:06 196KB 信号发生器 DDS FPGA

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vhdl dds 方波正弦波信号发生器

2019-12-21 19:24:05 6.69MB dds 方波 正弦波 信号发生器

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VHDL语言实现DDS的完整程序 Quartus仿真过

2019-12-21 19:23:43 4.3MB VHDL语言实现DDS的完整程序 Quartus仿真过

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基于VerilogHDL的SPWM全数字算法的FPGA实现

在详细阐述正弦脉宽调制算法的基础上，结合DDS 技术，以Actel FPGA 作为控制核心，通过自然采样法比较1 个三角载波和3 个相位差为1 200 的正弦波，利用Verilog HDL 语言实现死区时间可调的SPWM 全数字算法，并在Fushion StartKit 开发板上实现SPWM 全数字算法。通过逻辑分析仪和数字存储示波器得到了验证，为该技术进一步应用和推广提供了一个良好的开放平台。

2019-12-21 19:23:10 389KB Actel FPGA，SPWM，DDS，Verilog HDL

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STM32F407VET 基于DDS 用内置DAC实现实现多种波形输出，频率可调：范围1HZ-5MHZ

STM32F407VET.基于DDS 用内置DAC实现多种波形（正弦方波三角波锯齿波）输出，支持频率可调（范围1HZ-5MHZ 在5MHz下精度大约100khz左右）有自定义波形功能

2019-12-21 19:21:34 16.23MB DDS STM32 MHZ 频率可调

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基于VHDL dds正弦信号发生器dds正弦信号发生器

dds正弦信号发生器dds正弦信号发生器基于VHDL居于VHDL

2019-12-21 18:58:48 363B 正弦信号发生器

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DDS的ISE实现程序

程序已调通，VHDL源代码。。。。。。。。。。。。。。。

2019-12-21 18:58:40 495KB DDS

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AD9851 DDS数字频率合成器

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2019-12-21 18:58:21 594KB DDS数字频率合成器

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