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4位七段数数码管显示

仪器设备：逻辑设计与FPGA实验仪一套、装有ISE的PC机一台内容：按键增加、去抖动

2020-01-03 11:32:31 211KB verilog

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74HC4511七段译码器的资料

pdf的资料下载详细介绍了74HC4511的使用说明和注意事项

2020-01-03 11:24:47 83KB 74HC4511的资料

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PLC七段数码管显示十六种方法

用西门子S7200的PLC实现七段数码管显示共计十六种方法

2019-12-21 22:21:54 683KB PLC 七段数码管 显示 十六种方法

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VHDL语言编写的十进制计数器和七段译码器

VHDL语言编写的十进制计数器和七段译码器，下来就知道了

2019-12-21 21:01:06 515B VHDL 十进制计数器 七段译码器

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七段数码管时钟显示的硬件实现verilog

七段数码管时钟显示的verilog源代码，已做过FPGA验证。

2019-12-21 19:45:29 8.62MB 数码管 时钟显示

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用7段共阳数码管做的时钟 verilog程序

用7段共阳数码管做的时钟 verilog程序 // 时钟用4个数码管显示，显示秒和分，修改一下可以加上时或跑秒 // sys_clk为系统时钟：50MHz // seg_dat为输出给数码管的8个1bit信号 // seg_sl 为数码管位选通

2019-12-21 19:22:29 3KB 七段数码管 FPGA

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