一个简单双核CPU的verilog实现(加中断、异常处理已通过实验箱验证)可以实现双核交替访存,提高访问存储器效率,同时可以通过内存数据区实现双核数据的共享。
2019-12-21 20:10:43 30KB 双核 verilog CPU 实验箱
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本书主要介绍了TI的OMAPL138双核嵌入式处理器的结构特征,以及基于某款实验箱的典型应用案例
2019-12-21 19:50:15 56.26MB DSP
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全志v3 原理图参考设计, 淘宝买来的
2017-03-23 00:00:00 1.44MB v3 sdk 双核 高清
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