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用verilog写的倍频

用verilog写的倍频程序，很好用了，关于分频的以后再上传，大家好好学习一下吧，挺有用的啊

2019-12-21 21:55:14 1.26MB verilog

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FPGA实现A/B两相正交SE信号的四倍频电路_BDF

在运动控制系统中，对转轴编码器输出的A/B两相信号进行采样时，如果采用四倍频的方式，能提高位置的分辨率，该模块笔者在做一款三轴运动系统中采用的，经过测试效果很好。

2019-12-21 21:48:13 28KB FPGA SE_FOUR

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FPGA 编码器输入信号4倍频处理

FPGA 对电机的编码器输入的正交编码信号进行4倍频处理

2019-12-21 21:20:49 1KB FPGA 编码器

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运用凯斯西储大学滚动轴承故障数据，运用MOMEDA对信号进行周期的增强，提高信噪比，并运用希尔伯特变换，与Teager能量算子包络解调，体现Teager能量算子二次增强。同时还存在MCKD，

2019-12-21 20:58:11 2.27MB MOMEDA

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quartusii的PLL IP核分频和倍频

quartusii的PLL IP核分频和倍频，并且仿真通过，quartusii的PLL IP核分频和倍频

2019-12-21 20:27:01 2.96MB PLL，IP

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基于STM32F4系列的4个编码器4倍频的转速解析程序

基于STM32F4系列的4编码器4倍频转速解析程序，程序有效，需要根据自己的配置更改有问题欢迎提问。

2019-12-21 20:24:05 10.62MB STM32 编码器 转速解析 4倍频

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锁相环CD4046实现信号90度移相电路原理图

利用锁相环进行四倍频，然后取倍频信号与原型号相异或，即可得到与原信号相差90度相位的信号。本图提供了具体芯片和，电容电阻值。本图绝对原创，经本人及同行的实践使用证明，原电路正确无误，适合为锁相放大器提供两路正交信号。

2019-12-21 20:23:04 18KB 锁相环 CD4046 90度移相 四倍频

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最简单的倍频verilog程序（Quartus II）

一个工程文件几段简单的代码一个输入一个输出（50Mhz倍频到100Mhz）

2019-12-21 20:09:32 unknown verilog 倍频 quartus

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verilog设计2倍频

用verilog HDL语言通过两种方法实现设计2倍频

2019-12-21 20:07:48 655B 倍频

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Verilog HDL写的简单倍频程序

利用小数分频来得到倍频，倍频的倍数可以通过设置乘法器里面的数据得到

2019-12-21 19:52:48 2KB 倍频

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