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SFA-BCD.zip

2021-04-29 01:47:04 697KB 科研论文

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58-Vivado二进制与BCD码互转设计.7z

Vivado二进制与BCD码互转设计,Vivado仿真工程.

2021-04-01 09:06:43 103KB Vivado仿真工程 FPGA 二进制与BCD码互转 VerilogHDL

BCD译码数码管显示数字.zip

BCD译码数码管显示数字，仿真实例，现成调用封装使用，可运行的仿真电路图和调好的程序，开箱即用。适用于教学案例、毕业设计、电子设计比赛、出书项目实例，实际设计、个人DIY参考。已调试好，proteus直接可以运行看效果

2021-03-23 22:08:04 43KB BCD译码数码管 教学案例 电子设计 比赛

4位BCD码加法器的设计

ALU的设计与仿真—4位BCD码加法器的设计本次的设计内容是ALU的设计与仿真—4位BCD码加法器的设计。

2021-03-16 20:11:03 463KB 模型机 ALU BCD码 加法器

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Count Clock12H计数器（含有testbench测试文件）.zip

2021-02-10 22:05:13 5.64MB Verilog FPGA BCD计数器

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单片机-多字节二进制码转压缩BCD码示例.pdf

51单片机中常用的多字节二进制码转压缩BCD码的示例代码（含清晰的注释），后3页使用代码编辑器重排版（对齐、美观）。需要doc版本的可通过邮件zjyzfn@139.com联系。

2021-02-01 11:06:20 721KB 单片机 二进制 BCD 十六进制

单片机-多字节二进制码转压缩BCD码示例(修正内容)

51单片机中常用的多字节二进制码转压缩BCD码的示例代码（含清晰的注释），后3页使用代码编辑器重排版（对齐、美观）。需要doc版本的可通过邮件zjyzfn@139.com联系。

2021-02-01 11:06:19 833KB 单片机 二进制 BCD 十六进制

二进制转换为BCD码的VHDL实现

可以将8位二进制码转换为BCD码（二进制表示为12位）

2020-11-07 14:56:20 764B 二进制 BCD码 VHDL

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BCD码优先编码电路设计

74LS148是8线－3线优先编码器，共有54/74148和54/74LS148两种线路结构型式，将8条数据线（0－7）进行3线(4-2-1)二进制（八进制）优先编码，即对最高位数据线进行译码。利用选通端（EI）和输出选通端（EO）可进行八进制扩展

2020-01-03 11:32:39 155KB 电路设计

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8421 BCD 计数器 VHDL （0-9）

8421 BCD 计数器 VHDL （0-9） qt2 测试通过

2020-01-03 11:26:14 943B 8421 BCD 计数器 VHDL

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