该文件包含使用 16 QAM 调制方案在硬件上进行空中传输所需的完整链。 采用 RRC 脉冲整形。 该文件的某些部分是对 matlab 实现“commqpsktxrx”的修改。 接收器链分别由数据辅助 AGC、匹配滤波、频率补偿、定时同步和解码块组成。
2024-04-12 17:38:56 68KB matlab
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画PCB的人大多数里面,很多人在使用Protel! 其中说一下本人的感受: 曾今用过一段时间的Protel 99,个人认为,如果你只是做2PCB的话,完全够使!!但是对于复杂性的话,用99就有点难度了,这是后Altium提供了一个很好的解决办法!!
2024-04-11 14:35:19 49KB PROTEL 单层查看 显示设置
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SocanCode是一个能帮助软件开发人员自动生成代码的工具。内置了C#三结构模板,存储过程模板,使用它可以省去众多繁琐的重复工作,让开发人员把精力集中在业务逻辑上,大量减少重复劳动。让开发更便捷! 1、纯绿色软件,无需安装 2、支持Access,SqlServer,MySql,Oracle,SQLite,Sybase,DB2,PostgreSql连接 3、全模板化的代码生成器,轻松修改即可实现自定义各种编程语言模板、支持代码批量输出 4、内置一套强大的C#三架构模板,此模板支持生成简单三及工厂模式三,支持生成VS2005/2008/2010解决方案、支持生成缓存代码、支持生成分页代码 5、内置一套MySql和SqlServer的存储过程模板 6、支持直接执行SQL语句 7、内置代码转模板、C#转VB等小工具
2024-04-01 08:09:12 292KB 自动生成器
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2024-03-31 20:02:44 233B 谷歌地球
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2024-03-31 19:39:08 233B 历史地图
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该网络是一个典型的校园网络架构,采用华为ensp模拟器搭建。该压缩包中包含网络工程拓扑文件和项目报告文档,报告文档包含设计思路、网络规划、配置步骤及代码、网络功能测试等。该项目中涉及的技术包括,VLAN、链路聚合、DHCP、OSPF、缺省路由、VRRP、MSTP、ACL、NAT、DNS、FTP、WEB、无线WLAN、防火墙的相关配置等内容,功能自认为非常全面,需要做课设的和毕设的可以参考,不想动手敲代码的可以直接用,准备考网工证的也可以多参考跟着做一做,这里期待大家的下载。
2024-03-30 23:56:06 853KB 课程设计 网络搭建
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PDT DMR 物理matlab仿真
2024-03-30 17:33:05 1.35MB 物理层仿真 matlab
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有规划的人生,会让人感觉心里踏实;自然,有规划的设计,也是更让人信服,layout工程师也可以少走弯路。 板的数一般不会事先确定好,会由工程师综合板子情况给出规划,总数由信号数加上电源地的数构成。 一、电源、地数的规划 电源的数主要由电源的种类数目、分布情况、载流能力、单板的性能指标以及单板的成本决定。电源平面的设置需要满足两个条件:电源互不交错;避免相邻重要信号跨分割。 地的数设置则需要注意以下几点:主要器件面对应的第二要有比较完整的地平面;高速、高频、时钟等重要信号要参考地平面;主要电源和地平面紧耦合,降低电源平面阻抗等等。 二、信号数规划 布线通道通常是决定信号数的重要因素。首先要清楚板上是否有比较深的和连接器,的深度和的PIN间距是决定BGA出线数的关键。例如1.0mm的BGA过孔间一般可以过两根线,0.8mm的BGA过孔之间只能过一根线,两者出线数就有很大的区别。连接器则主要考虑其深度,基本两个过孔之间过一对差分线。 两个过孔间能过两根线的BGA出线,共用2个走线 两个过孔间只能过一根线的BGA出线,共用4个走线
2024-03-28 11:14:49 101KB PCB设计 硬件设计
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小筱邸住宅,2,现代风格su模型AR080276.skp
2024-03-27 17:28:34 9.64MB
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基于模块化 SRAM 的 2D 分搜索 二进制内容可寻址存储器 (BCAM) Ameer MS Abdelhadi 和 Guy GF Lemieux 不列颠哥伦比亚大学 (UBC) 2014 { ameer.abdelhadi; Guy.lemieux } @ gmail.com 建议的基于模块化 SRAM 的 2D 分搜索二进制内容可寻址存储器 (BCAM) 的完全参数化和通用 Verilog 实现以及其他方法作为开源硬件提供。 还提供了批量运行流程管理器,用于使用 Altera 的 ModelSim 和 Quartus 批量仿真和综合具有各种参数的各种设计。 许可证: BSD 3-Clause(“BSD New”或“BSD Simplified”)许可证。 请参阅全文以获取更多信息: AMS Abdelhadi 和 GGF Lemieux,“使用基于 FPGA 的 BRAM
2024-03-27 11:10:03 3.1MB Verilog
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