一、 实验目的与要求: 用verilog语言编写出一个除法器的代码,并在modelsim中进行功能仿真,认真的完成实验报告。 二、 实验设备(环境)及要求: 在modelsim环境下编写代码与测试程序,并仿真; 在synplify pro下编译,设置硬件并综合。 三、 实验内容及步骤: 1、 选择除法器的算法,本实验开始采用的是减法实现除法器的例子(比如十进制中的a/b,可先比较a与b的大小,如果a>b,则商加1,a<=a-b,再进行比较大小,直到a
2019-12-21 20:23:47 290KB verilog 除法器 两种 代码
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运用汇编语言编写一个高精度的除法运算,有源程序代码
2019-12-21 20:18:44 62KB 高精度除法预算
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用c模拟浮点数硬件除法 有四舍五入及特殊情况分析
2019-12-21 20:08:51 2KB 计算机组成
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详细说明:实现了几种阴影去除算法,包括相除法、HSV法等四种-Achieved several shadow removal algorithms, including the phase division, HSV law four kinds of
2019-12-21 19:57:47 44.22MB 去除阴影
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MATLAB计算长除法的GUI程序,做MATLAB GUI练习时编的。
2019-12-21 19:50:16 205KB MATLAB 长除法 自动控制原理 自控
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除法器:32处以16位,fpga可综合,verilog代码
2019-12-21 19:44:17 22KB 除法器
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数据结构中的一元多项式的除法,用单向链表实现,也涉及到一元多项式的加法等等。
2019-12-21 19:41:27 3KB 数据结构 一元多项式的除法
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32位除法器设计Verilog代码.zip
2019-12-21 19:40:41 724B 除法器 Verilog 代码
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详细的设计与说明 代码全,设计简单,有原理说明图示范
2019-12-21 19:40:10 184KB vhdl 除法器
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原码加减交替除法的代码,还有整个程序设计的流程,最后是运行效果
2019-12-21 19:40:03 128KB 组成原理
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