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仿真数字频率计实验报告

数字电路仿真实验报告，用Multisim软件仿真数字频率计。

2019-12-21 21:30:29 303KB multisim仿真

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数字频率计 VHDL代码

本科毕业设计用的非常简洁实用的代码，VHDL实现

2019-12-21 21:30:27 1.92MB 频率计 VHDL

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2015全国大学生电子设计大赛F题一等奖--数字频率计

2019-12-21 21:24:58 579KB 电子设计

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基于FPGA的数字频率计设计

数字频率计的设计，本文主要讲述了如何实现数字频率计采用EDA技术用VHDL编程实现，包括源代码和实验结果截图，很详细

2019-12-21 21:16:28 6.66MB 数字频率计 EDA数字频率计 频率计 VHDL

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基于VHDL语言的3位数字频率计

基于VHDL语言的3位数字频率计含报告 VHD文件

2019-12-21 21:15:30 165KB 基于VHDL语言 3位

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基于Verilog的数字频率计的代码

Vorilog语言编写的数字频率计测频部分的代码，本人毕业设计测频部分实用代码，绝对有效。系统的时钟频率为100M，包含50M的自检信号。

2019-12-21 21:13:54 6.86MB 数字频率计

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基于Verilog HDL数字频率计的设计与实现

基于Verilog HDL数字频率计的设计与实现，工程

2019-12-21 21:10:05 4.16MB VerilogHDL 数字频率计 占空比 quartus

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基于Multisim数字频率计的设计与仿真

希望对各位有用，写得很细，基于Multisim数字频率计的设计与仿真，某人的课程设计

2019-12-21 21:04:29 4.62MB 强烈推荐

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此文档系笔者参加2015年全国电子设计竞赛的F题—数字频率计所撰写的作品报告，实物作品先后获得了北京市一等奖和全国二等奖，里面的方案可以参考，但是仍旧需要在此基础上进行调试，同时配合相应的ARM和FPGA软件代码，从而实现良好的频率计功能。

2019-12-21 21:03:48 124KB 2015全国电设 F题国二

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eda课程设计数字频率计的设计

EDA课程设计，数字频率计的设计。用VHDL语言

2019-12-21 20:59:51 125KB EDA

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