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shift_register8.rar_VHDL/FPGA/Verilog_VHDL_源码

XilinxFPGA Verilog 8位的移位寄存器

2021-08-11 18:04:34 224KB VHDL/FPGA/Verilog VHDL

infrared_receive.rar_VHDL/FPGA/Verilog_VHDL_源码

红外接收处理，根据外部波形记录波形的高低电平时间，从而得到波形数据。

2021-08-11 18:04:18 638B VHDL/FPGA/Verilog VHDL

XPS_EMC.rar_VHDL_源码

Xilinx 公司 nor flash控制器接口，使用EDK搭建工程完成设计

2021-08-10 20:03:31 58KB VHDL

Design Patterns for Reconfigurable Computing.zip_嵌入式/单片机/硬件编程_VHDL_源码

研究分享FPGA設計適用的設計模式，也分享了应用实例，与建议教训

2021-08-10 15:04:56 148KB 嵌入式/单片机/硬件编程 VHDL

方案二.zip_VHDL/FPGA/Verilog_VHDL_源码

本系统是基于CPLD和单片机的一种用于信号频率周期、时间间隔和占空比测量的数字频率计，系统由AGC（自动增益控制）电路、宽带放大电路、高速比较电路实现有效值10mV/频率100MHz和处理显示部分组成，其中AGC电路实现幅度自动增益控制使放大后的信号幅度在一定的范围内保持一致，比较电路将前级电路输出的信号转换成CPLD

2021-08-10 10:36:42 77KB VHDL/FPGA/Verilog VHDL

FPGA/CPLD轻松实现CRC16位校验（VHDL源码）

FPGA/CPLD轻松实现CRC16位校验（VHDL源码）数据通信中，多字节的数据参与CRC校验。 CCITT标准的校验多项式:0x1021,用于HDLC等通信帧

2021-07-08 16:04:54 251KB FPGA/CPLD轻松实现CRC16位校验（VHDL源码）

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xilinx中值滤波程序vhdl源码 median filter

FPGA应用。VHDL语言实现图像处理中的种植滤波

2021-05-31 12:57:20 525KB xilinx FPGA VHDL median filter

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数字信号处理的ＦＰＧＡ实现—第三版　含verilog和vhdl 源码

2021-03-10 12:10:10 52.77MB fpga 第三版 verilog vhdl

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VHDL基础程序例程基础教程初学代码 FPGA测试 VHDLG源码.zip

VHDL基础程序例程基础教程初学代码 FPGA测试 VHDL源码,包括大量的设计实例，逻辑源码，可以做为你的学习参考。

2021-02-13 15:04:59 121.71MB VHDL VHDL基础程序例程 初学代码 FPGA测试VHDL源码

基于CPLD多波形函数信号发生器的设计-本科毕业设计论文，包括硬件原理图PCB工程及VHDL源码文件.zip

基于CPLD多波形函数信号发生器的设计-本科毕业设计论文，包括protel 99se 硬件原理图PCB工程及VHDL源码文件

2021-02-13 15:04:58 6.07MB CPLD多波形函数信号发生器 本科毕业设计论文 protel99se硬件原理 原理图PCB工程

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