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FPGA实现CAN总线控制器开源代码.zip

本代码是FPGA实现CAN总线控制器的开源代码，工程文件可直接通过ISE调试！

2019-12-21 19:23:20 1.01MB IP核 CAN总线 控制

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SDRAM的IP核VerilogHDL源代码

SDRAM的IP核VerilogHDL源代码，绝对可用

2019-12-21 19:21:15 27KB SDRAM IP核 Verilog HDL

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CAN总线IP核的VerilogHDL源码

CAN总线IP核源码，非常成熟的源码，可以直接拿来用

2019-12-21 19:21:14 60KB CAN 总线 IP核 Verilog

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Xilinx FPGA应用进阶通用IP核详解和设计开发

2019-12-21 18:58:39 45.57MB Xilinx FPGA

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Nexys 4 DDR开发板的DDR2 IP核引脚约束文件

Nexys 4 DDR开发板的DDR2 IP核的引脚约束文件（在例化DDR2 IP核的时候需要用到）。

2019-12-21 18:52:53 6KB Xilinx Vivado DDR2 Nexys4

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QuartusII最全licence—带各种IP核

QuartusII各版本都可使用，很多人不知道，其实各版本的licence是可共用的，只是破解程序有些区别。

2019-12-21 18:51:40 1.11MB QuartusII licence IP核

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FPGA MC8051移植 100M频率计设计详细步骤

摘要：以FPGA为核心器件，嵌入mc8051 IP核,1602液晶显示器等作为外围，设计的等精度频率计。通过1602液晶显示被测频率值,闸门时间自动调整，测量范围为0.1Hz—100MHz。

2019-12-21 18:51:05 14.69MB MC8051 IP核 FPGA VHDL

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使用quartus15.0做的fft ip 核工程文件

使用quartus15.0做的fft ip 核工程文件，已经通过modelsim10.4d仿真通过

2019-08-05 02:33:57 75.26MB fft ip 核

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Vivado 2016.1 License文件（多IP核）

整合了多个license文件，去除了部分当前已经过期的IP，IP核最近过期的也要到2025年1月，设计工具的License可用到2037年5月，干货满满，亲测可用！

2017-03-21 00:00:00 5KB Vivado 2016.1 License

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异步FIFO IP核

压缩包里是异步FIFO的IP核。。。。。。。。。。。。。。。。。。。。。。

2010-03-12 00:00:00 742KB 异步FIFO IP核

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