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SDRAM控制
器(用Verilog编写)
用Verilog写的
sdram控制
器 经过测试 好用的
sdram控制
模块
2019-12-21 20:00:26
2.69MB
sdram
verilog
1
DDR3 SDRAM原理和初始化、读写的Verilog实现(Sdram 控制器.pdf)
讲解 sdram 的工作原理,以及使用 verilog HDL 语言描述
sdram控制
器,其中包括 sdram 的初始化、刷新、读和写。 FPGA 自带的内部存储空间非常的有限,当需要存储大量数据时,一般是借助于外围的存储设备, sdram 就是常用的存储设备之一,因为掌握 sdram 的内部工作原理,以及描述 sdram 控制器是 FPGA 工程师需要掌握的基本技能。
2019-12-21 19:47:03
642KB
DDR3
SDRAM
FPGA
1
DDR2+
SDRAM控制
器的设计与验证
DDR2+
SDRAM控制
器的设计与验证,研究实现操作简便、带宽高的DDR2C设计方法。主要内容包括如何简化对DDR2 SDRAM的操作和最大限度的提高DDR2接口的带宽。
2019-12-21 19:42:49
2.47MB
DDR2控制器
1
一个基于FPGA的PCI数据采集程序,包括
SDRAM控制
,PCI9054时序控制,开发语言verilog,开发环境quartus
一个基于FPGA的PCI数据采集程序,包括
SDRAM控制
,PCI9054时序控制,开发语言verilog,开发环境quartus
2019-12-21 19:26:01
2.67MB
一个基于FPGA的PCI数据采集程序
包括SDRAM控制
PCI9054时序控制
开发语言verilog
开发环境quartus
1
基于verilog语言实现的
SDRAM控制
器设计(含源代码)
基于verilog语言实现的
SDRAM控制
器设计(含源代码)
2019-12-21 19:24:04
4.14MB
SDRAM控制器
verilog
FPGA
1
SDRAM控制
器_Verilog版(下板可用)
自己写的
SDRAM控制
器包括上电初始化,自刷新,读,写,仲裁五大模块,实际下板可用PLL相移已调试好
2019-12-21 19:21:37
47.58MB
SDRAM控制器
1
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