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数字电路实验
74LS192计数计-加/减法
实现两位十进制数的加计数和减计数,依此类推,可实现n位数的计数
2019-12-21 21:00:52
370KB
数字电路
实验
74LS192
1
数字电路实验
设计, 全加器、8421转2421...
数字电路的一些实验设计, 两位加法器、全加器、8421转2421、触发器....
2019-12-21 20:46:46
471KB
、8421
数字电路
实验设计
1
Nexys4开发板使用手册
Nexys4开发板使用手册
2019-12-21 20:26:33
1.7MB
Nexys4
开发板
数字电路实验
使用手册
1
中山大学
数字电路实验
时钟设计大作业dsn文件
使用Proteus实现具有分、秒计时的计数器,计数结果要求在7段数码管(7SEG-MPX4-CC-RED)上显示,并检查结果 在Proteus设计上给计时器添加调整当前时间功能,即添加进入调整计时模式(MOD)按键和分/秒计数循环加一(ADJ)按键。 使用Proteus实现具有年、月、日、时、分、秒计时的计时器,计时结果要求显示在7段数码管上,要求年、月、日、时、分、秒均可调节。
2019-12-21 19:58:10
254KB
proteus
1
浙江理工大学
数字电路实验
实验七-时序逻辑电路的设计multisim电路模拟
包括D触发器逻辑功能测试1、D触发器逻辑功能测试2、D触发器逻辑功能测试3、利用74LS161设计BCD5421码十进制计数器,multisim模拟电路完全正常
2019-12-21 19:25:48
328KB
浙江理工大学
数电实验
时序逻辑电路
1
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