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集成电路设计Cadence Virtuoso上的AMS数模电路混合仿真例程
集成电路设计Cadence Virtuoso上的AMS数模电路混合仿真例程
上传者:
hsiyueh
|
上传时间: 2022-12-30 16:22:46
|
文件大小: 530KB
|
文件类型: PDF
Verilog
Cadence
Virtuoso
AMS
AMS-Designer是一个模拟环境,允许模拟混合信号设计。模拟器使用Spectre和NC-Verilog分别仿真模拟和数字部分。互连模块用于在连接在一起的模拟端口和数字端口之间转换信号,通常用工具自带的转换库connect_lib来自动完成。 通过构建一个模拟电路的反相器和一个Verilog描述的反相器串联来完成数模混合仿真的例程。
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