多功能数字钟的设计实验报告

Verilog FPGA

本文利用 Verilog HDL 语言的设计方法设计多功能数字钟，并通过 vivado 2016.3 完成综合实现。此程序通过下载到 FPGA 芯片后，可应用于实际的数字钟显示中，实现了基本的计时显示（时分到分秒的切换）和设置，调整时间，闹钟设置的功能。

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Ekikyo :

没用，不要下载
2021-01-05

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