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FPGA实现的数字密码锁
FPGA实现的数字密码锁
上传者:
38647039
|
上传时间: 2021-12-22 12:46:01
|
文件大小: 86KB
|
文件类型: -
VHDL
FPGA
断电保护
文章
本文介绍了一种以FPGA为基础的数字密码锁。采用自顶向下的数字系统设计方法,将数字密码锁系统分解为若干子系统,并且进一步细划为若干模块,然后用硬件描述语言VHDL来设计这些模块,同时进行硬件测试。测试结果表明该数字密码锁能够校验10位十进制数字密码,且可以预置密码,设有断电保护装置,解码有效指示等相应功能。
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