双端口RAM实现两路数据的延时

verilo fpga

代码主要介绍一下使用双端口RAM实现延时的过程。（。。。fifo是 first input first output 的缩写，即先进先出队列，fifo一般用作不同时钟域的缓冲器。fifo根据读和写的时钟是否为同一时钟分为同步fifo和异步fifo。异步fifo相比同步fifo来说，设计更加复杂一点。本文中讲述的是同步fifo的一种设计方法。）

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