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硬件设计和验证语言SystemVerilog
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上传者:
42038119
|
上传时间: 2022-04-06 02:15:17
|
文件大小: 9.82MB
|
文件类型: ZIP
开发语言
SV
systemverilog
电路
资源包含: 1. IEEE英文标准(1800-2017)和 2. 部分中文解读说明文档(语言参考手册) 英文标准内容丰富完整,参考手册可以帮助快速和更好的理解和应用标准语言!
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