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基于VHDL 语言的浮点乘法器的硬件实现
基于VHDL 语言的浮点乘法器的硬件实现
上传者:
ziziyeli
|
上传时间: 2021-11-17 06:53:39
|
文件大小: 177KB
|
文件类型: -
浮点乘法器
VHDL
本文提出了一种基于VHDL 语言的浮点乘法器的硬件实现方法, 就是用VHDL 语言描述设计文件, 用 FPGA 实现浮点乘法, 并在Maxplus2 上进行了模拟仿真, 得到了很好的结果. 该浮点乘法可以实现任意位的乘 法运算.
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