介绍一种提高直接数字合成器（DDS）系统时钟频率的并行处理方法。给出了一个基于现场可编程门阵列（FPGA）的具有400MHz系统时钟频率DDS电路的实现方法和实验测试结果。采用直接中频输出方式，输出频率范围250MHz～350MHz，频率分辨率6Hz，寄生信号抑制50dB。该DDS电路具有接口简单、使用灵活等优点，可用于雷达、电子战领域的宽带信号产生。
2022-07-13 13:53:59
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并行多通道DDS频率合成器的研究，张骁勇，唐宗熙，分析了并行多通道DDS频率合成器的原理,介绍了并行多通道DDS频率合成器的应用。采用HP ADS和ADIsimPLL仿真软件对一个并行多通道DDS频率合��
2021-12-02 10:15:38
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