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uart_tx_byte.zip

传统的串口通信协议只能一个字节一个字节的发送，当遇到需要同时发送多个字节数据时，就不行了，但是这个项目可以根据自己的需要通过串口发送多个字节数据，而不是只能发送一个字节

2022-06-15 09:43:28 153KB verilog uart 多字节

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Verilog程序设计交通灯控制.doc

Verilog程序设计交通灯控制

2022-06-14 19:07:04 28KB 文档资料

2022-06-14 18:56:39 6KB verilog 交通信号灯

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基于verilog的单周期cou设计

本项目主要利用Verilog语言设计一一个基于MIPS架构的CPU。分别设计指令存储器、寄存器堆、ALU、取指令部件、数据存储器、立即数处理单元、主单元控制器、ALU控制单元。内含仿真，可直接仿真验证。

2022-06-14 11:10:25 3.73MB FPG CP

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同步fifo.zip

FIFO的Verilog源代码，可以任意调整深度的，不错，已经验证过异步fifo下次发源代码

2022-06-14 00:07:21 2KB FIFO Verilog 源代码 调整深度

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串并转换Verilog HDL

串并转换Verilog HDL FPGA，为了你能认真读代码，测试程序请自己编写，改代码经过调试正确

2022-06-13 20:50:12 2KB 串并转换Verilog HDL FPGA

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12均匀分布随机数的Verilog HDL语言程序设计.doc

12均匀分布随机数的Verilog HDL语言程序设计

2022-06-13 18:05:30 15KB 文档资料

Verilog HDL模型的不同抽象级别.ppt

2022-06-13 09:05:09 3.57MB Verilog

Verilog数字设计基础.ppt

2022-06-13 09:05:08 3.66MB Verilog

SPI的verilog实现

SPI的verilog实现有详细的注释全面且容易理解好东西分享一下

2022-06-13 01:48:27 8KB SPI verilog

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